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188宝金博页面版: 芯片IO缓冲及ESD设计

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内容提示: 芯片 I /O 缓冲及 ESD 电路设计 摘要: 文章详细介绍了基于 CMOS 的芯片 I/O 缓冲电路分类, 功能, 电路及版图设计的一些考虑以及芯片引脚的静电保护问题。 广告插播信息 维库最新热卖芯片:ST10043QC IRFR024N SMBJ5. 0CA XC17S10PD8C ICL7612BCPA TC35302P 24LC128T-I/SN TC551001BFL-85L PQ30RV21 UPD485505G-35 关键词: I/O; 缓冲电路; 静电保护; CMOS 针对引脚的输入输出缓冲(I/O buffer) 电路设计, 也可以称为输入输出接口(I/O interface) 电路设计, 是一颗完整芯片设计中不可或缺的组成部分,但是详细论述其设计规则的文章或者著作在国内却比较鲜见, 这...

文档格式:DOC | 页数:9 | 浏览次数:31 | 上传日期:2014-11-05 23:19:44 | 文档星级:
芯片 I /O 缓冲及 ESD 电路设计 摘要: 文章详细介绍了基于 CMOS 的芯片 I/O 缓冲电路分类, 功能, 电路及版图设计的一些考虑以及芯片引脚的静电保护问题。 广告插播信息 维库最新热卖芯片:ST10043QC IRFR024N SMBJ5. 0CA XC17S10PD8C ICL7612BCPA TC35302P 24LC128T-I/SN TC551001BFL-85L PQ30RV21 UPD485505G-35 关键词: I/O; 缓冲电路; 静电保护; CMOS 针对引脚的输入输出缓冲(I/O buffer) 电路设计, 也可以称为输入输出接口(I/O interface) 电路设计, 是一颗完整芯片设计中不可或缺的组成部分,但是详细论述其设计规则的文章或者著作在国内却比较鲜见, 这对初学者或者没有这方面经验的工程师无疑会造成困惑。 本文以 CMOS 工艺为例, 较全面的论述I/O 缓冲电路设计中各种考虑, 可以作为芯片引脚输入输出电路设计的一个参考。 根据 I/O 缓冲电路应用目标的不同, 可将其分为输入、 输出等几类, 详见表1。 表 1 I/O 缓冲电路的分类 输出缓冲(是个大驱动器, 他将信号输出芯片) 输出缓冲电路的功能要求能够驱动大的片外负载, 通常为 2~50pF, 并且提供适当的上升/下降时间。 一组连续的大尺寸的缓冲器(buffer) 对驱动能力的提高是有益的。 大尺寸的管子容易受闩锁效应(latch-up) 的影响, 在版图设计时建议采用保护环(Guardrings) 保护以避免闩锁效应, 如图 1-1 所示。 在图中, 用P+作为内保护环, 而 N+作为外保护环(In n-well) 。

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