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188宝金博页面版: ARM920T虚拟地址原理分析及实现

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内容提示: 第五章 虚拟内存及缓冲区管理 在刚开始接触 TQ2440 并测试 TEST 程序时,当时就产生了一个疑惑,把程序下载到 NAND 和 SDRAM 中,其中断均能正确执行,当时以为,程序有可能采用了动态添加中断向量技术,即在 SDRAM 中运行时在向量 0x18 处添加跳转指令的二进制编码。虽然能够实现,但在实际编程时会非常麻烦。 ARM 采用了虚拟内存映射技术即 MMU,负责虚拟地址到物理地址的映射,并提供硬件机制的内存访问权限检查,通过使用 CACHE 及 WRITE BUFFER 技术缩小处理器和存储系统的差别,从而提高系统的整体性能。 在系统加电时,将 ROM/FLASH 映射为地址 0,进行一些初始化工作并...

文档格式:DOC | 页数:10 | 浏览次数:38 | 上传日期:2017-02-23 16:33:39 | 文档星级:
第五章 虚拟内存及缓冲区管理 在刚开始接触 TQ2440 并测试 TEST 程序时,当时就产生了一个疑惑,把程序下载到 NAND 和 SDRAM 中,其中断均能正确执行,当时以为,程序有可能采用了动态添加中断向量技术,即在 SDRAM 中运行时在向量 0x18 处添加跳转指令的二进制编码。虽然能够实现,但在实际编程时会非常麻烦。 ARM 采用了虚拟内存映射技术即 MMU,负责虚拟地址到物理地址的映射,并提供硬件机制的内存访问权限检查,通过使用 CACHE 及 WRITE BUFFER 技术缩小处理器和存储系统的差别,从而提高系统的整体性能。 在系统加电时,将 ROM/FLASH 映射为地址 0,进行一些初始化工作并将程序加载到 SDRAM 中去,然后启用 MMU,将虚拟地址 0 映射到 SDRAM 地址(0x30000000),这样当中断产生时读取 0x18 处的指令时实际读取的是 0x30000018处的指令,这样中断就就可以正确执行。 S3c2440 内存管理单元有如下特征: 4 种映射长度,段 1M、大页 64k、小页 4k,极小页 1k 指令 TLB(含 64 个条目)、数据 TLB(含 64 个条目) 硬件访问页表地址映射、权限检查由硬件自动完成 第一节 CP15 寄存器的功能及读写 ARM 的虚拟地址管理主要通过 CP15 相关寄存器来实现的,CP15 包括了 16 个 32 位寄存器,编号为 0~15,实际上对于某些编号的寄存器可能对应有多个物理寄存器,在指令编码时指定标志位来区分。 CP15 寄存器功能 编号 MMU 功能 C0 ID 编码(只读) C1 开启/禁止 MMU/CACHE/WRITE 等功能 C2 地址转换表基地址 C3 域访问控制 C4 保留 C5 内存失效状态 C6 内存失效状态 C7 CACHE 及 WRITE 控制 C8 TLB 控制 C9 CACHE 锁定 C10 TLB 锁定 C11 保留 C12 保留 C13 进程 PID C14 保留 C15 CP15 寄存器的读写 MCR ARM 寄存器到协处理器寄存器数据传送 MRC 协处理器寄存器到 ARM 寄存器数据传送 格式: MCR/MRC P15,0,<RD>,<CRN>,<CRM>,{,<OPCODE_2>} 其中 RD 为 ARM 寄存器 CRN 为协处理器寄存器 CRM 附加的目标寄存器或源操作数寄存器,用于区分一个编号的不同物理寄存器,当指令不需要提供附加信息时,将 CRMC0 指定为,OPCODE_2 指定为 0

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